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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
ispMACH 4000V/B/C Timing Adders 1 (Cont.)
Adder
Base
-5
-75
-10
Type
Parameter
Description
Min.
Max.
Min.
Max.
Min.
Max. Units
Optional Delay Adders
t INDIO
t EXP
t ORP
t BLA
t INREG
t MCELL
—
t ROUTE
Input register delay
Product term expander delay
Output routing pool delay
Additional block loading adder
—
—
—
—
1.00
0.33
0.05
0.05
—
—
—
—
1.00
0.33
0.05
0.05
—
—
—
—
1.00
0.33
0.05
0.05
ns
ns
ns
ns
t IOI Input Adjusters
LVTTL_in
LVCMOS33_in
LVCMOS25_in
LVCMOS18_in
PCI_in
t IN , t GCLK_IN ,
t GOE
t IN , t GCLK_IN ,
t GOE
t IN , t GCLK_IN ,
t GOE
t IN , t GCLK_IN ,
t GOE
t IN , t GCLK_IN ,
t GOE
Using LVTTL standard
Using LVCMOS 3.3 standard
Using LVCMOS 2.5 standard
Using LVCMOS 1.8 standard
Using PCI compatible input
—
—
—
—
—
0.60
0.60
0.60
0.00
0.60
—
—
—
—
—
0.60
0.60
0.60
0.00
0.60
—
—
—
—
—
0.60
0.60
0.60
0.00
0.60
ns
ns
ns
ns
ns
t IOO Output Adjusters
LVTTL_out
t BUF , t EN , t DIS Output configured as TTL buffer
—
0.20
—
0.20
—
0.20
ns
LVCMOS33_out t BUF , t EN , t DIS Output configured as 3.3V buffer
LVCMOS25_out t BUF , t EN , t DIS Output configured as 2.5V buffer
LVCMOS18_out t BUF , t EN , t DIS Output configured as 1.8V buffer
—
—
—
0.20
0.10
0.00
—
—
—
0.20
0.10
0.00
—
—
—
0.20
0.10
0.00
ns
ns
ns
PCI_out
Slow Slew
t BUF , t EN , t DIS
t BUF , t EN
Output configured as PCI compatible
buffer
Output configured for slow slew rate
—
—
0.20
1.00
—
—
0.20
1.00
—
—
0.20
1.00
ns
ns
Note: Open drain timing is the same as corresponding LVCMOS timing. Timing v.3.2
1. Refer to TN1004, ispMACH 4000 Timing Model Design and Usage Guidelines for information regarding use of these adders.
36
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